《時鍾發生器在片上係統處理器中的應用》針對在SOC芯片上使用的全集成頻率閤成器的設計，從電路和係統的角度對鎖相環的原理和設計進行瞭分析。特彆是在電路層次上，討論瞭深亞微米CMOS數字工藝中的低電壓模擬電路的設計，有比較大的參考意義。在對鎖相環基本工作原理分析的基礎之上，《時鍾發生器在片上係統處理器中的應用》分析瞭具體的時鍾産生方案和電路設計問題，並進一步討論瞭鎖相環的應用。《時鍾發生器在片上係統處理器中的應用》還包括瞭PLL可測試性設計的內容。最後還從宏觀角度討論瞭SOC時鍾域的設計。書中包含的大量實際問題分析應該有助於讀者更好地理解時鍾産生器設計中的核心問題。
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