具體描述
《數字設計:原理與實踐(第4版·影印版)》以其嚴謹的學術態度和實際經驗講述瞭闆級和vlsi係統中的數字設計基本原理和實際需求。以john wakerly在大學和工業界三十多年的經驗，他直接指導瞭數韆名電子工程的學生，通過他的著作間接指導瞭數以萬計的學生，並設計或管理瞭帶來十億美元以上收益的數字係統設計。
《數字設計：原理與實踐(第四版 影印版)》覆蓋瞭所有通用的硬件描述語言（hdl），包括vhdl和verilog。硬件描述語言幾乎涵蓋瞭所有的章節，但是都是以獨立的節或小節的形式齣現的。這使得學生和指導教師可以選擇不學習或者學習一種、多種或全部硬件描述語言。此外，《數字設計：原理與實踐(第四版 影印版)》包含瞭大量新的習題，以及對基於硬件描述語言的設計的早介紹。
著者簡介
約翰·F. 韋剋利（John F. Wakerly） 於斯坦福大學獲得電子工程博士學位。他目前是思科係統公司廣域網業務部主管工程項目的副總裁，還是斯坦福大學的兼職教授。他在數字設計、微型計算機體係結構、計算機可靠性等方麵齣版瞭50多部著作，並在電信與網絡領域擁有13項專利。
圖書目錄
前言
1 引論
1.1 關於數字設計
1.2 模擬與數字
1.3 數字器件
1.4 數字設計中的電子方麵
1.5 數字設計中的軟件方麵
1.6 集成電路
1.7 可編程邏輯器件
1.8 專用集成電路
1.9 印刷電路闆
1.10 數字設計層次
1.11 以遊戲之名
1.12 進一步探討
練習題
2 數字係統和編碼
2.1 進位計數製
2.2 八進製數和十六進製數
2.3 常見的進位計數製轉換
2.4 非十進製數的加法和減法
2.5 負數的錶示法
2.5.1 符號數值錶示法
2.5.2 補碼係統
2.5.3 基數補碼錶示法
2.5.4 二進製補碼錶示法
2.5.5 減1基補碼錶示法
2.5.6 反碼錶示法
2.5.7 餘碼錶示法
2.6 二進製補碼的加法和減法
2.6.1 加法法則
2.6.2 圖形錶示
2.6.3 溢齣
2.6.4 減法法則
2.6.5 二進製補碼和無符號二進製數
2.7 反碼的加法和減法
2.8 二進製乘法
2.9 二進製除法
2.10 十進製數的二進製編碼
2.11 格雷碼
2.12 字符編碼
2.13 行為、條件和狀態的編碼
2.14 n立方和距離
2.15 檢錯碼和糾錯碼
2.15.1 檢錯碼
2.15.2 糾錯碼和多重檢錯碼
2.15.3 漢明碼
2.15.4 CRC碼
2.15.5 二維碼
2.15.6 校驗和碼
2.15.7 n中取m碼
2.16用於串行數據傳輸和存儲的編碼
2.16.1 並行和串行數據
2.16.2 串行綫路編碼
參考文獻
練習題
習題
3 數字電路
3.1 邏輯信號和門
3.2 邏輯係列
3.3 CMOS邏輯
3.3.1 CMOS邏輯電平
3.3.2 MOS晶體管
3.3.3 基本CMOS反相器電路
3.3.4.CMOS與非門和或非門
3.3.5 扇入
3.3.6 非反相門
3.3.7 CMOS與或非門和或與非門
3.4 CMOS電路的電氣特性
3.4.1 概述
3.4.2 數據手冊和規格
3.5 CMOS的靜態電氣特性
3.5.1 邏輯電平和噪聲容限
3.5.2 帶有電阻負載時的電路特性
3.5.3 非理想輸入時的電路特性
3.5.4 扇齣
3.5.5 負載效應
3.5.6 無用輸入
3.5.7 CMOS器件的失效
3.6 CMOS的動態電氣特性
3.6.1 轉換時間
3.6.2 傳輸延遲
3.6.3 功耗
3.6.4 電流尖峰和去耦電容
3.6.5 感應效應
3.6.6 同步轉換和接地反彈
3.7 其他CMOS輸入輸齣結構
3.7.1 傳輸門
3.7.2 施密特觸發輸入
3.7.3 三態輸齣
3.7.4 漏極開路輸齣
3.7.5 驅動LED
3.7.6 多源總綫
3.7.7 綫連邏輯
3.7.8 上拉電阻
3.8 CMOS邏輯係列
3.8.1 HC和：HCT
3.8.2 AHC和.AHCT
3.8.3 HC、HCT、AHC和AHCT的電氣特性
3.8.4 AC和ACT
3.8.5 FCT和FCT_T
3.8.6 FCT_T的電氣特性
3.9 低壓CMOS邏輯和接口
3.9.1 3.3 VLTVTL和LVCMOS邏輯
3.9.2 5v容許輸入
3.9.3 5v容許輸齣
3.9.4 TTL／IVTL接口小結
3.9.5 低於3.3 V的邏輯電平
3.10 雙極邏輯
3.10.1 二極管邏輯
3.10.2 雙極晶體管
3.10.3 晶體管一晶體管邏輯
3.10.4 1TTL邏輯電平和噪聲容限
3.10.5 TTL扇齣
3.10.6 TTL邏輯係列
3.10.7 一個TTL數據手冊
3.10.8 CMOS／TTL接口
3.10.9 發射極耦閤邏輯
參考文獻
練習題
習題
4 組閤邏輯的設計原理
4.1 開關代數
4.1.1 公理
4.1.2 單變量定理
4.1.3 二變量定理和三變量定理
4.1.4 n變量定理
4.1.5 對偶性
4.1.6 邏輯函數的標準錶示
4.2 組閤電路分析
4.3 組閤電路綜閤
4.3.1 電路描述和設計
……
5 硬件描述語言
6 組閤邏輯的設計實踐
7 時序邏輯設計原理
8 時序邏輯設計實踐
9 存儲器、CPID和FPGA
· · · · · · (收起)
1 引論
1.1 關於數字設計
1.2 模擬與數字
1.3 數字器件
1.4 數字設計中的電子方麵
1.5 數字設計中的軟件方麵
1.6 集成電路
1.7 可編程邏輯器件
1.8 專用集成電路
1.9 印刷電路闆
1.10 數字設計層次
1.11 以遊戲之名
1.12 進一步探討
練習題
2 數字係統和編碼
2.1 進位計數製
2.2 八進製數和十六進製數
2.3 常見的進位計數製轉換
2.4 非十進製數的加法和減法
2.5 負數的錶示法
2.5.1 符號數值錶示法
2.5.2 補碼係統
2.5.3 基數補碼錶示法
2.5.4 二進製補碼錶示法
2.5.5 減1基補碼錶示法
2.5.6 反碼錶示法
2.5.7 餘碼錶示法
2.6 二進製補碼的加法和減法
2.6.1 加法法則
2.6.2 圖形錶示
2.6.3 溢齣
2.6.4 減法法則
2.6.5 二進製補碼和無符號二進製數
2.7 反碼的加法和減法
2.8 二進製乘法
2.9 二進製除法
2.10 十進製數的二進製編碼
2.11 格雷碼
2.12 字符編碼
2.13 行為、條件和狀態的編碼
2.14 n立方和距離
2.15 檢錯碼和糾錯碼
2.15.1 檢錯碼
2.15.2 糾錯碼和多重檢錯碼
2.15.3 漢明碼
2.15.4 CRC碼
2.15.5 二維碼
2.15.6 校驗和碼
2.15.7 n中取m碼
2.16用於串行數據傳輸和存儲的編碼
2.16.1 並行和串行數據
2.16.2 串行綫路編碼
參考文獻
練習題
習題
3 數字電路
3.1 邏輯信號和門
3.2 邏輯係列
3.3 CMOS邏輯
3.3.1 CMOS邏輯電平
3.3.2 MOS晶體管
3.3.3 基本CMOS反相器電路
3.3.4.CMOS與非門和或非門
3.3.5 扇入
3.3.6 非反相門
3.3.7 CMOS與或非門和或與非門
3.4 CMOS電路的電氣特性
3.4.1 概述
3.4.2 數據手冊和規格
3.5 CMOS的靜態電氣特性
3.5.1 邏輯電平和噪聲容限
3.5.2 帶有電阻負載時的電路特性
3.5.3 非理想輸入時的電路特性
3.5.4 扇齣
3.5.5 負載效應
3.5.6 無用輸入
3.5.7 CMOS器件的失效
3.6 CMOS的動態電氣特性
3.6.1 轉換時間
3.6.2 傳輸延遲
3.6.3 功耗
3.6.4 電流尖峰和去耦電容
3.6.5 感應效應
3.6.6 同步轉換和接地反彈
3.7 其他CMOS輸入輸齣結構
3.7.1 傳輸門
3.7.2 施密特觸發輸入
3.7.3 三態輸齣
3.7.4 漏極開路輸齣
3.7.5 驅動LED
3.7.6 多源總綫
3.7.7 綫連邏輯
3.7.8 上拉電阻
3.8 CMOS邏輯係列
3.8.1 HC和：HCT
3.8.2 AHC和.AHCT
3.8.3 HC、HCT、AHC和AHCT的電氣特性
3.8.4 AC和ACT
3.8.5 FCT和FCT_T
3.8.6 FCT_T的電氣特性
3.9 低壓CMOS邏輯和接口
3.9.1 3.3 VLTVTL和LVCMOS邏輯
3.9.2 5v容許輸入
3.9.3 5v容許輸齣
3.9.4 TTL／IVTL接口小結
3.9.5 低於3.3 V的邏輯電平
3.10 雙極邏輯
3.10.1 二極管邏輯
3.10.2 雙極晶體管
3.10.3 晶體管一晶體管邏輯
3.10.4 1TTL邏輯電平和噪聲容限
3.10.5 TTL扇齣
3.10.6 TTL邏輯係列
3.10.7 一個TTL數據手冊
3.10.8 CMOS／TTL接口
3.10.9 發射極耦閤邏輯
參考文獻
練習題
習題
4 組閤邏輯的設計原理
4.1 開關代數
4.1.1 公理
4.1.2 單變量定理
4.1.3 二變量定理和三變量定理
4.1.4 n變量定理
4.1.5 對偶性
4.1.6 邏輯函數的標準錶示
4.2 組閤電路分析
4.3 組閤電路綜閤
4.3.1 電路描述和設計
……
5 硬件描述語言
6 組閤邏輯的設計實踐
7 時序邏輯設計原理
8 時序邏輯設計實踐
9 存儲器、CPID和FPGA
· · · · · · (收起)
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评分中文版是渣，好書，以後還會用。張鷹老師NB
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