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設計與驗證Verilog HDL

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吳繼華
人民郵電
2006-8
228
32.00元
9787115150417

圖書標籤: verilog  Verilog  FPGA  集成電路  硬件設計  fpga  電子與半導體技術  理工學習   


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发表于2024-11-26

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圖書描述

《設計與驗證》以實例講解的方式對HDL語言的設計方法進行介紹。全書共分9章,第1章至第3章主要介紹瞭Verilog HDL語言的基本概念、設計流程、語法及建模方式等內容;第4章至第6章主要討論如何閤理地使用Verilog HDL語言描述高性能的可綜閤電路;第7章和第8章重點介紹瞭如何編寫測試激勵以及Verilog的仿真原理;第9章展望HDL語言的發展趨勢。

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用戶評價

評分

工程性強

評分

工程性強

評分

很棒的入門書,需要反復參看。 講解瞭Verilog的語言特性和綜閤特性。

評分

做FPGA不錯的書

評分

對代碼到電路之間的對應關係有瞭一個比較好的理解,有不少比較好的例子來幫助讀者理解

讀後感

評分

看过夏宇闻的那本verilog数字系统设计,大部分细节都有提到,但是不够具体。这本书比那本书好,主要在于对待问题能够结合事物的本质,以及实际经验,并且内容安排层次分明,详略得当,很全面。 举例二三: 0.硬件描述语言与C语言的区别 Verilog采用了C语言的形式,但是描述的是...

評分

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評分

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